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L3缓存命中大约需要50个周期；而需要访问DRAM的L3缓存未命中则需350个周期以上，相差一个数量级。由于每核心缓存减少了六分之五，在第13代硬件上运行FL1访问内存的频率要高得多，从而招致了延迟惩罚。
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